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IDT70V9089/79S/L
High Speed 3.3V 64/32K x 8 Synchronous Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
Timing Waveform Port-to-Port Flow-Through Read (1,2,3,5)
CLK "A"
t SW t HW
R/ W "A"
t SA
t HA
ADDRESS "A"
DATA IN "A"
MATCH
t SD
t HD
VALID
NO
MATCH
t CCS (4)
CLK "B"
t CD1
R/ W "B"
t SW t HW
t SA
t HA
ADDRESS "B"
MATCH
t CWDD (4)
NO
MATCH
t CD1
DATA OUT "B"
t DC
VALID
t DC
VALID
3750 drw 09
NOTES:
1. Transition is measured 0mV from Low or High-impedance voltage with the Output Test Load (Figure 2).
2. CE 0 and ADS = V IL ; CE 1 and CNTRST = V IH .
3. OE = V IL for the Port "B", which is being read from. OE = V IH for the Port "A", which is being written to.
4. If t CCS < maximum specified, then data from right port READ is not valid until the maximum specified for t CWDD .
If t CCS > maximum specified, then data from right port READ is not valid until t CCS + t CD1 . t CWDD does not apply in this case.
5. All timing is the same for both left and right ports. Port "A" may be either left or right port. Port "B" is the opposite of Port "A".
12
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